[7급 국가직 전자회로] 26년 1회차 기출문제 정답·해설 페이지
- NOR: 로 A=B=1일 때 0이 되어 맞지 않는다.
- XOR: 로 입력이 다를 때 1이므로 정반대다.
- NAND: 로 A와 B가 다를 때도 1이 되어 맞지 않는다.
- 위상 천이 발진기로 동작한다는 설명은 RC 사다리와 반전 증폭기로 이루어진 구조 그대로이므로 옳다.
- RC 네트워크가 180°를 만들어야 한다는 설명은 반전 증폭기의 180°와 합쳐 360°가 되어야 하므로 옳다.
- 발진을 시작하려면 루프 이득이 1보다 커야 한다는 설명은 바크하우젠 기동 조건이므로 옳다.
- 은 궤환 저항과 접지 저항의 역할을 뒤바꾼 식이다.
- 는 1보다 작은 분압비로, 증폭부의 이득이 될 수 없다.
- 는 반전 입력에 걸리는 궤환률로, 이득의 역수에 해당한다.
- 이면 양의 제한 레벨이 3.7 V가 되어 그림의 6.7 V와 다르다.
- 이면 음의 제한 레벨이 -6.7 V가 되어 그림의 -3.7 V와 다르다.
- AND: 입력이 모두 1일 때 1이어야 하나, 이 회로는 그때 0이다.
- OR: 입력 중 하나라도 1이면 1이어야 하나, 이 회로는 그때 0이다.
- NAND: NMOS가 직렬, PMOS가 병렬인 정반대 구성이어야 한다.
- 41.7은 전파 정류처럼 리플 주파수를 120 Hz로 잡은 값이다.
- 166.6은 리플을 피크 간 2 V가 아닌 1 V로 대입한 값이다.
- 20.8은 정답의 1/4 크기로, 반파 정류 리플 식에서 나오지 않는 값이다.
- 1 V는 컬렉터 저항 강하를 14 V로 잡아야 나오는 값으로 계산과 맞지 않는다.
- 3 V, 4 V는 베이스 전류를 더 작게 잡아야 나오는 값이다.
- 107 mA는 다이오드 전압 강하를 빼지 않고 더한 값이다.
- 10.7 V는 B 쪽 베이스 전압()이다.
- 5 V는 분압점 전압을 출력으로 착각한 값이다.
- 10 V는 분압비를 1/2로 잡은 값이다.
- 20 V는 분압비를 1/4로 잡은 값으로 저항 비와 맞지 않는다.
- 10은 연산증폭기 자체의 개루프 대역폭이다.
- 50은 폐루프 이득 값이다.
- 는 개루프 직류 이득이다.
- T3~T4 구간에 Q1=0, Q2=1인 조합은 T3에서의 Q1 토글을 놓친 것이다.
- T6~T7 구간에 Q1=1인 조합은 T5에서 J=0, K=1로 리셋된 것을 놓친 것이다.
- T6~T7 구간에 Q2=1인 조합은 T4 하강 에지의 리셋을 반영하지 않은 것이다.
- 60 V는 D가 -3 V에서 클램프한다고 보고 구한 값으로, D이 먼저 도통하는 점을 놓쳤다.
- 57 V, 63 V는 클램프 레벨 와 2차 피크 36 V로 정해지는 위 결과와 맞지 않는다.
- 되먹임용 AND 게이트 2개와 NAND 게이트 4개(클록 게이팅 2개 + SR 래치 2개)로 JK 플립플롭을 구성할 수 있다.
- J와 K 입력을 하나로 묶어 T 입력으로 쓰면 추가 게이트 없이 T 플립플롭이 된다.
- J=K=1이면 클록마다 출력이 반전(토글)되어 T=1인 T 플립플롭과 같다.
- 20은 비반전 이득의 1을 빼고 도통 시 저항비만 본 값이다.
- 30, 40은 접지 측 저항 변화 폭을 과대하게 잡은 값으로 회로 저항과 맞지 않는다.
- 1000, 0100은 초기값 0101에서 하강 에지 세 번의 시프트를 따라가면 나올 수 없는 값이다.
- 1101은 상승 에지에서 동작한다고 보고 구한 결과와 같다.
- 은 차원이 가 아니어서 2차항 계수가 될 수 없다.
- 는 을 빠뜨렸고 차원도 맞지 않는다.
- 는 를 빠뜨렸고 차원도 맞지 않는다.
- 이면 베이스 전류가 0.025 mA로 컬렉터 전류가 2.5 mA가 된다.
- 이면 컬렉터 저항 강하가 10 V가 되어 을 만족하지 못한다.
- 하한 19.8 nF은 최솟값을 2배로 잡은 값으로 1600 kHz까지 동조되지 않는다.
- 상한 173.8 nF은 최댓값을 2배로 잡은 값으로 540 kHz 조건과 맞지 않는다.
- 이면 컬렉터 전류가 약 26.7 mA로 40 mA를 만들지 못한다.
- 6 V는 베이스-이미터 전압 0.7 V를 빠뜨린 값이다.
- 100 kHz는 변화량을 40 V로 이중 계산한 값이다.
- 10 kHz, 20 kHz도 왜곡 없이 통과하지만 슬루율 한계보다 훨씬 낮아 최대 주파수가 아니다.
- 인 조합은 출력 커패시턴스에서 를 뺀 값이다.
- , 인 조합은 를 게이트-소스 성분으로 혼동한 것이다.
- 0에서 +5 V로 올라가는 삼각파는 적분기의 반전을 빠뜨린 것이다.
- 최저 -7.5 V의 삼각파는 기울기를 1.5배로 잡은 것으로 RC 값과 맞지 않는다.
- 최고 +7.5 V의 삼각파는 반전과 크기가 모두 틀렸다.
- 출력전압 평균 는 반파 정류 평균값 공식 그대로이므로 옳다.
- 출력전류 평균은 평균전압을 10 Ω으로 나눈 값이므로 옳다.
- 출력전류 실횻값 은 반파 정류의 실횻값 공식이므로 옳다.
- 문턱이 -1 V와 +9 V이지만 Vin 증가 시 +15 V에서 -15 V로 떨어지는 곡선은 반전형 동작이다.
- 문턱이 ±5 V로 대칭인 곡선들은 기준 전압 3 V에 의한 중심 이동을 무시한 것이다.
다음 NOT-AND-OR 게이트로 구성된 논리회로와 같은 출력값(Y)을
갖는 논리 게이트는?
NOR
XOR
NAND
XNOR
회로의 출력은 XNOR 게이트와 같다.
윗 AND는 A와 B를 그대로 받아 , 아랫 AND는 두 NOT 출력을 받아 를 낸다. OR로 합치면 로, 두 입력이 같을 때만 1이 된다.
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다수의 RC 회로로 구성된 네트워크와 이득이 -K인 연산증폭기를
사용한 다음 회로에 대한 설명으로 옳지 않은 것은? (단, 연산증폭기는
이상적이다)
위상 천이 발진기로 동작할 수 있다.
RC 회로 네트워크는 발진을 위해 180도의 위상 천이를 만들 수 있어야 한다.
일정한 주파수의 발진을 위해서는 최소 2개의 RC 회로가 있어야 한다.
발진을 시작하려면 K는 루프 이득이 1보다 큰 값이 되도록 선택되어야 한다.
일정 주파수 발진에 최소 2개의 RC 회로면 된다는 설명이 옳지 않다.
RC 한 단이 만드는 위상 천이는 90° 미만이므로 180°를 얻으려면 최소 3단이 필요하다. 이 180°가 반전 증폭기(-K)의 180°와 합쳐져 루프 위상 360°를 이룬다.
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다음 윈브리지(Wien bridge) 발진기 회로의 폐루프 이득으로 옳은
것은?
폐루프 이득은 비반전 증폭기 이득 이다.
R은 출력과 반전 입력 사이(궤환), R는 반전 입력과 접지 사이에 있고 신호는 비반전 입력으로 들어온다.
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그림 (가) 회로에 정현파 전압 을 입력할 때, 그림 (나)의 출력
전압 을 얻기 위한 전압 [V]와 [V]를 바르게 연결한 것은?
(단, 다이오드 , 의 순방향 전압은 0.7 [V]이다)

3 3
3 6
6 3
6 6
필요한 전압은 , 이다.
D은 출력이 을 넘으면 도통해 양의 피크를 6.7 V로 제한한다.
D는 애노드가 전지 음극 쪽()에 있어 출력이 보다 낮아지면 도통해 음의 피크를 -3.7 V로 제한한다.
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다음 그림과 같이 CMOS를 이용한 디지털 논리회로의 출력을 나타낸
논리 게이트는?
AND
OR
NAND
NOR
이 CMOS 회로는 NOR 게이트다.
풀업 PMOS Q, Q, Q는 5 V와 출력 사이에 직렬이라 A, B, C가 모두 0일 때만 출력이 1이 된다. 풀다운 NMOS Q, Q, Q는 병렬이라 입력 중 하나만 1이어도 출력이 0이 된다. 즉 이다.
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다음 회로에서 피크(peak)값이 [V]이고 주파수가 60 [Hz]인
정현파 입력 신호 가 인가된다. 부하 저항 [kΩ]으로
가정할 때 출력 전압 의 최고조 간 (peak-to-peak) 리플 (ripple)
전압이 2 [V]일 경우, 커패시터 C[F]의 값은? (단, 다이오드는
이상적인 모델이다)
20.8
41.7
83.3
166.6
커패시터 값은 약 83.3 μF이다.
다이오드가 하나인 반파 정류이므로 리플 주파수는 입력과 같은 60 Hz다.
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다음 회로에서 [V]은? (단, [V], [V],
[V], 이다)
1
2
3
4
출력 전압은 2 V이다.
베이스 전류:
컬렉터 전류:로, 0.2 V보다 크므로 활성 영역 가정도 성립한다.
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이상적인 OP-amp 회로의 전압이득 은?
1
2
3
4
전체 전압이득은 1이다.
1단 반전 증폭:
2단 반전 증폭:
3단 비반전 증폭:— 두 번의 반전으로 부호가 양이 된다.
2단은 입력 저항(60 kΩ)이 궤환 저항(10 kΩ)보다 커서 감쇠단이 되므로, 1단과 3단 이득의 곱 6을 1/6이 정확히 상쇄한다. 3은 3단 비반전 이득만 본 값이다.
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다음 회로에서 전류 [mA]와 전압 [V]으로 바르게 연결한
것은? (단, [V], [V], 이고,
다이오드 , 의 순방향 전압은 0.7 [V]이다)

93 9.3
93 10.7
107 9.3
107 10.7
, 이다.
무신호 시 바이어스 전류는 R→D→D→R를 흐른다(베이스 전류 무시).
, 이미터는 로 전원의 절반에 놓인다.
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다음 회로에서 입력전압 에 30 [V]의 비안정화 전압이 입력되고
있다. 모든 트랜지스터의 베이스-이미터 순방향 전압은 0.7 [V]이며
제너 다이오드의 제너 전압은 4.3[V]이다. 안정화된 출력전압 [V]는?
5
10
15
20
안정화된 출력 전압은 15 V이다.
오차 검출 트랜지스터 Q가 동작하려면 베이스가 0.7 V여야 하고, 그 위에 제너 4.3 V가 직렬로 놓여 분압점 전압은 로 고정된다.
분압점은 출력을 5 kΩ과 2.5 kΩ으로 나눈 점이다.
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회로의 비반전 증폭기에 사용된 연산 증폭기(A(s))는 다음과 같은
전달 함수 특성을 나타내고 있다. 이 경우 비반전 증폭기의 대역폭
[rad/s]은?
10
50
20000
비반전 증폭기의 대역폭은 약 20000 rad/s이다.
폐루프 이득: , 궤환률
개루프 직류 이득 , 극점— 이득·대역폭 곱 을 이득 50으로 나눈 값과 같다.
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다음 그림 (가)의 JK 플립플롭 회로에서 Q 값은 초기에 모두 ‘0’인
상태에서 시작한다. 그림 (나)와 같은 입력 조건일 때, 구간 T3 ~T4와
구간 T6 ~T7에서 Q1, Q2의 상태를 바르게 연결한 것은? (단, 각
플립플롭의 상태변화 시 지연은 없다)
| 구간(T3 ~ T4) | 구간(T6 ~ T7) | ||
|---|---|---|---|
| Q1 | Q2 | Q1 | Q2 |

0 1 1 0
1 0 1 1
1 1 0 0
1 1 1 0
T3~T4 구간은 Q1=1, Q2=1이고, T6~T7 구간은 Q1=0, Q2=0이다.
Q1 플립플롭은 CLK 상승 에지(T1, T3, T5, T7), Q2 플립플롭은 NOT을 거친 CLK이므로 하강 에지(T2, T4, T6, T8)에서 동작한다. K는 T1 이전부터 계속 1이다.
Q1: T1(J=0)에서 리셋 0, T3(J=K=1)에서 토글 1, T5(J=0)에서 0, T7(J=K=1)에서 1.
Q2: T2(J=K=1)에서 토글 1, T4(J=0)에서 0, T6(J=0)에서 0 유지.
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다음 회로에서 [V], [V], 다이오드
과 의 순방향 전압은 3 [V]이다. 변압기의 턴 비가
1:3일 때, 다이오드 의 최대 역전압[V]은? (단, 모든 소자는
이상적으로 동작한다)
57
60
63
69
D의 최대 역전압은 69 V이다.
2차 전압 피크: . 노드 전압은 이고, 음의 반주기에 노드가 까지 내려가면 D이 먼저 도통해 커패시터를 충전한다(D는 -3 V에서야 도통하므로 먼저 걸리지 않는다).
노드 최대:
D 역전압:
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JK플립플롭에 대한 설명으로 옳지 않은 것은?
입력 J와 Q를 2입력 AND 게이트에 K와 를 또 다른 2입력 AND 게이트에 통과시켜, SR 플립플롭의 S와 R 대신 사용할 수 있다.2개의 2입력 AND 게이트와 4개의 2입력 NAND 게이트로 JK 플립플롭을 구현할 수 있다.
추가 논리 게이트 없이 JK 플립플롭으로 T 플립플롭을 구현할 수 있다.
J =K =1인 경우는 T 플립플롭에서 T =1인 경우와 동일하게 작동한다.
옳지 않은 것은 J를 Q와, K를 와 AND 하여 S·R 대신 쓴다는 설명이다.
JK 플립플롭은 SR 플립플롭의 금지 입력을 없애려고 출력을 되먹임한다. 올바른 연결은 , 로, J는 와, K는 Q와 AND 해야 한다.
설명처럼 J·Q, K·로 묶으면 Q=0일 때 J가 막혀 세트가 불가능하고, Q=1일 때 K가 막혀 리셋이 불가능해 JK 동작이 되지 않는다.
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다음과 같은 이상적인 연산증폭기를 이용한 회로에서 전압이득의
최댓값과 최솟값의 차는? (단, n채널 JFET의 게이트 입력전압은
0 [V]에서 차단전압 까지 변화한다)
10
20
30
40
전압이득의 최댓값과 최솟값의 차는 10이다.
비반전 증폭기의 궤환 저항은 100 kΩ이고, 접지 측 저항은 10 kΩ과 (10 kΩ+JFET 채널)의 병렬이다.
게이트 0 V(JFET 도통, 채널 저항≈0): ,
게이트 (JFET 차단): ,
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다음은 SR 플립플롭을 사용한 4비트 시프트 레지스터이다. 그림과
같은 입력 조건일 때 T1 시점에서 출력 는? (단, 초기에
각 플립플롭의 상태 는 0101이며, 각 플립플롭의 상태변화
시 지연은 없다)
1000
0100
1010
1101
T1 시점의 출력 는 1010이다.
클록 입력에 버블이 있어 각 플립플롭은 하강 에지에서 동작하며, S=X, R=X의 반전이므로 매 하강 에지마다 X가 q로 들어가고 나머지는 한 칸씩 이동한다. T1 이전 하강 에지는 세 차례다.
초기 0101 → 첫째(X=1) 1010 → 둘째(X=0) 0101 → 셋째(X=1) 1010. T1은 넷째 펄스의 High 구간이라 아직 변하지 않는다.
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다음 회로의 전달함수가 일 때,
X는? (단, 연산증폭기는 이상적이다)
X는 이다.
이 회로는 이득 1의 살렌-키 저역통과 필터로, 일반식은
를 대입하면 1차항은 , 2차항 계수는 이다.
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다음 회로에서 [mA], [V]일 때, [kΩ]와
[kΩ]를 바르게 연결한 것은? (단, 트랜지스터의 ,
[V], [V]이다)

200 1
200 2
400 1
400 2
, 이다.
베이스 전류:
컬렉터 저항:
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진폭변조(AM, Amplitude Modulation) 라디오의 공진회로 또는
동조회로는 다음과 같다. L =1 [H]로 주어졌을 때 공진주파수를
처음부터 끝까지 조정할 수 있는 AM 밴드의 C[nF]값의 범위는?
(단, AM 방송의 주파수 범위는 540 [kHz] ~1600 [kHz]이다)
19.8 ~86.9
9.9 ~86.9
19.8 ~173.8
9.9 ~173.8
필요한 C의 범위는 약 9.9 ~ 86.9 nF이다.
병렬 LC 공진: 로, 주파수가 낮을수록 큰 C가 필요하다.
540 kHz:
1600 kHz:
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다음은 BJT를 이용한 디지털 스위치 회로이다. 안정된 LED 구동을
위해서 컬렉터 전류는 40 [mA]의 포화 전류가 필요하다. 이때 필요한
[Ω]와 입력 구형파 전압 의 진폭[V]을 바르게 연결한 것은?
(단, 확실한 포화를 위해 베이스 전류는 최솟값의 3배가 되도록 하며
[V], [V], [V], [V],
[kΩ], 이다)

200 6
200 6.7
300 6
300 6.7
, 입력 진폭은 이다.
컬렉터 저항:
베이스 전류 최솟값: , 3배 →
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연산증폭기를 이용한 전압 팔로워 (unity-gain buffer)에 다음과
같은 삼각파가 인가되는 경우, 출력이 왜곡되지 않을 삼각파의
최대주파수[kHz]는? (단, 연산증폭기의 슬루율은 S =8 [V/s]이다)
10
20
100
200
왜곡 없이 통과할 수 있는 최대 주파수는 200 kHz이다.
삼각파는 반주기 동안 -10 V에서 10 V까지 20 V 변하므로 기울기는 이다. 이것이 슬루율을 넘지 않아야 한다.
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다음은 게이트, 드레인, 소스 간 기생 커패시턴스를 포함한 MOSFET을
나타내는 회로이다. 이 MOSFET의 입력 커패시턴스 [pF],
역방향 전달 커패시턴스 [pF], 출력 커패시턴스 [pF]일
때, 게이트-드레인 간 기생 커패시턴스 [pF], 게이트-소스 간
기생 커패시턴스 [pF], 드레인-소스 간 기생 커패시턴스 [pF]를
바르게 연결한 것은?

2 3 7
2 3 8
3 2 8
3 2 7
, , [pF]이다.
데이터시트 커패시턴스와 기생 성분의 관계는 다음과 같다.
, ,역방향 전달 커패시턴스가 곧 이므로 , 이다.
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다음 회로의 입력전압()이 그림과 같은 구형파일 때 출력전압
()은? (단, 연산증폭기는 이상적이고, 커패시터의 초깃값은
0 [V]이다)
[그림]
[그림]
[그림]
[그림]
출력은 0에서 -5 V까지 내려갔다가 0으로 돌아오는 삼각파(100 μs에서 최저 -5 V)이다.
회로는 반전 적분기로 이다.
입력 +5 V인 0~100 μs 동안 출력은 0 → -5 V로 내려가고, -5 V인 100~200 μs 동안 다시 0 V로 올라간다. ±10 V 포화에는 닿지 않는다.
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다음 반파정류회로에서 옳지 않은 것은? (단, 다이오드는 이상적인
모델이고, 부하저항 R =10 [Ω], 정현파 전원의 전압 =220
[]이며 주파수는 60 [Hz]이다)
출력전압의 평균값 [V]출력전류의 평균값 [A]출력전류의 실횻값 [A]부하에 공급되는 전력 [W]부하 전력을 로 쓴 설명이 옳지 않다.
반파 정류 출력의 최댓값 , 실횻값은 이다. 따라서 전력은 실횻값 전류로 구한다.
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다음 회로의 입출력 히스테리시스 특성 곡선으로 옳은 것은? (단,
[Ω], [kΩ], [V]이고 연산증폭기는
이상적이다)
[그림]
[그림]
[그림]
[그림]
상승 문턱 +9 V, 하강 문턱 -1 V인 비반전 슈미트 트리거 곡선이 옳다(Vin이 커지며 +9 V에서 +15 V로, 작아지며 -1 V에서 -15 V로 바뀜).
비반전 입력 전압: , 전환 조건
일 때 에서 상승, 일 때 에서 하강한다. 기준 전압 때문에 문턱이 4 V를 중심으로 치우친다.
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