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1[7급 국가직 전자회로] 24년 1회차
다음 D급 전력증폭기 회로에 대한 설명으로 옳지 않은 것은? (단, 연산증폭기는 이상적이다)

문제 이미지
1
VA > VT일 때, VC는 -VCC이다.
2
VA > VT일 때, M1은 도통(ON), M2는 차단(OFF)된다.
3
VA < VT일 때, Vo는 대략 +VDD이다.
4
VC = +VCC일 때, M1은 차단, M2는 도통된다.
해설

옳지 않은 것은 VAV_A라는 설명이다.

VAV_A는 반전 입력, VTV_T는 비반전 입력이므로 VAV_A

  • VA>VTV_A>V_T일 때 비교기 출력 −VCC-V_{CC}: 반전 입력이 더 크므로 옳다.
  • VA>VTV_A>V_T일 때 상단 도통·하단 차단: 게이트가 음전압이라 PMOS 만 켜지므로 옳다.
  • 비교기 출력 +VCC+V_{CC}일 때 상단 차단·하단 도통: 옳다.

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